カス日記 WSL上のmatplotlibで日本語フォント付き可視光スペクトルバーを生成する方法
Python の matplotlib を使って「可視光スペクトルバー」を描画し、日本語タイトルを付けて画像として保存する方法を紹介します。Linux や WSL など日本語フォント環境が不完全な場合でも、豆腐（□）にならずにちゃんと日本語...
カス日記 環境構築 Windows11のWSLgで外部Xサーバを使う
今年（2025年）10月をもって、Windows 10のサポートが終了する予定です。そのため、今後のセキュリティや安定性を考慮すると、本格的にWindows 11への移行を検討する必要があります。しかし、移行に際して技術的な課題がいくつか存...
FPGA Kria SOM を電源投入時から JTAG boot するようにする方法
Kria SOM の Starter Kit（KR260 や KV260）は、電源投入時のデフォルトの Boot Mode が QSPI になっています。しかし、この設定では Vitis で作成したハードウェアを実行する前に、XSCT を使...
FPGA Vivadoで不要なバス幅をカット！XLSliceの活用方法
皆さん、突然ですが、「設計したIPを使い回したいけれど、元のバス幅は不要で、任意の範囲だけ使いたい」 という場面、よくありますよね？Vivadoの仕様では、バス幅が異なる信号を接続すると、それぞれの下位ビットから自動的に接続される 仕様にな...
FPGA KR260 SFP+ Port Constrains
KR260でSFP+を使う際に必要な制約のメモ📝高速シリアル通信に関連する信号RD_P：Receive Data Positive のポート，T2RD_N：Receive Data Negative のポート，T1TD_P：Transmit...
環境構築 Overleafのローカル環境を構築する方法
必要な準備Dockerがインストールされていること。サーバのIPアドレスが確認できること。手順1. Overleafツールキットのクローンと初期化まず、OverleafのツールキットをGitHubからクローンし、初期化を行います。git c...
FPGA Vivadoのブロックデザインを共有する方法
Vivadoのtclコンソールに以下の様に記載することでブロックデザインを書きだすことができる．write_bd_tcl [Path]/[file_name].tclブロックデザインを書きだしたtclから再現する際にはVivadoのTool...
FPGA KR260 と 10G/25G Ethernet Subsystem IP
KR260 にはSFP+が実装されていて，10G通信ができる．いままでなんとなくで使っていたIPについて調べてみる．このIPには，PMA・PCS・MACが含まれているが，MACの機能を使うと有償のライセンスが必要になる．そのため，個人で利用...
FPGA Zynq DMA IPを使用する際，Vitisに登場する変数名について
XPAR_SCUGIC_SINGLE_DEVICE_IDXilinx の Zynq-7000 シリーズなどの SoC（System on Chip）におけるシングル GIC（Generic Interrupt Controller）のデバイ...
Network wireshark と ipsendwin の共存方法
ipsendwin が問題なく動作していたPCにwiresharkをインストールしたら，「wpcap.dll がない」といわれ，ipsendwinが起動できなくなった．•Win10Pcapをインストールすることで解決•参考リンク